1)使用仿真驗證工具進行FPGA設計驗證工作:2)進行FPGA設計的靜態時序分析、編碼規則檢查、邏輯等效驗證、跨時鐘域分析3)協助制定驗證大綱，編寫驗證測試激勵、編寫完成驗證工作的相關文檔4)搭建驗證環境，編寫并執行測試用例。任漑提要求:1)熟練掌握Verilog/System Verilog/VHDL/TcI等語言，熟練掌握Modelsim、Vivado和ISE等EDA工具2)集成電路/電子/通訊/計算機/自動化控制相關專業3)具有良好的發現問題和解決問題的能力，具有良好的文檔書寫能力:4)具有良好的溝通能力，團隊協作能力，對待事情認真負責專注。5)有FPGA驗證經驗者優先:

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